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上課地點：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）：AMS Methodology Kit培訓(xùn)(Cadence)：2025年5月19日....--即將開課--...............................(歡迎您垂詢，視教育質(zhì)量為生命！)
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        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。
　　AMS Methodology Kit培訓(xùn)(Cadence)

課程簡介

????本課程將會采用一個實際的模擬電路，該電路是一塊完整的網(wǎng)卡芯片中的一個6位的模數(shù)轉(zhuǎn)換器中的采樣保持電路，我們將使用該模擬電路塊，讓參與人員有機會在Cadence的Virtuoso定制電路設(shè)計平臺上，完整地經(jīng)歷從原理圖輸入、器件電學(xué)參數(shù)設(shè)置、電路模擬仿真、版圖的生成、DRC/LVS等物理規(guī)則檢查、寄生參數(shù)提取、后版圖仿真及反標(biāo)、以及電壓降和電遷徙的可靠性檢查，Cadence已經(jīng)為所有的設(shè)計步驟準(zhǔn)備好了正確而完整的數(shù)據(jù)，參加培訓(xùn)的工程師可以將其作為模版而完成自主的設(shè)計，首先，所有參與培訓(xùn)的工程師需要在4天的時間內(nèi)，在Cadence講師的輔助下，基于Cadence的工具平臺，利用Cadence提供的數(shù)據(jù)，完成從設(shè)計前端到后端的所有工作，然后工程師在參照參考設(shè)計的前提先，自行完成該電路從前到后的所有設(shè)計，從而熟悉整個模擬集成電路設(shè)計的步驟和流程；

?

課程說明：

????該課程是一個以參加培訓(xùn)人員自己動手為主的實習(xí)課程，不是Cadence的工具培訓(xùn)，而是基于設(shè)計方法學(xué)的一個設(shè)計實例課程，Cadence工具的詳細(xì)的使用方法不會被設(shè)計，所有工具的使用都是為了保證設(shè)計課程的順利完成，不能代替Cadence的工具培訓(xùn)。

?

涉及的工具列表：

Virtuoso Schematic Editor

Analog Design Environment

Virtuoso Specification Driven Envrionment

Virtuoso Hierarchy Editor

Virtuoso Spectre simulator

UltraSim simulator

Virtuoso-XL layout Editor

Assura DRC/LVS

Assura RCX

Virtuoso Analog VoltageStorm Option

Virtuoso Analog EletronicStorm Option



階段 1:基于混合信號驗證（AMS Top Level Verification Flow）的培訓(xùn)
  • 正向設(shè)計如何在系統(tǒng)層面上基于全芯片的指標(biāo)驗證
  • 對用Verilog描述的數(shù)字模塊和VerilogA或者晶體管描述的模擬模塊進(jìn)行混合仿真
  • 在模塊沒有進(jìn)行版圖實現(xiàn)時的頂層寄生效應(yīng)的仿真
階段 2:基于模擬和定制電路設(shè)計（AMS Block Level Creation Flow）的流程培訓(xùn)
  • 呈現(xiàn)模擬集成電路模塊設(shè)計的完整流程
  • 原理圖的輸入、Spectre仿真、設(shè)計冗余分析、連接驅(qū)動版圖實現(xiàn)
  • DRC/LVS物理驗證、寄生參數(shù)提取
  • 后版圖仿真和對比、行為級查表模型的自動生成
階段 3:基于數(shù)模混合電路的后端物理設(shè)計（Analog Driven Physical Implementation Flow）的培訓(xùn)
  • 實現(xiàn)在基于全芯片面積約束下的布局和布線
  • 在頂層布局下向模擬模塊和數(shù)字模塊傳遞模塊形狀和Pin的位置信息
  • 自動實現(xiàn)數(shù)字和模擬模塊之間的連接
  • 在頂層實現(xiàn)層次化的DRC/LVS物理驗證和寄生參數(shù)提取
  • 簡單的數(shù)字電路布局布線
 
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上海總部培訓(xùn)基地

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（地鐵昌平線沙河站B出口） 郵編：102200 行走路線：請點擊這查看！
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